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cva6-dcls 是一套处于早期阶段的 CVA6 双核锁步平台。公开仓库确认了 DCLS 方向，也显示项目仍有开发活动，但目前尚未提供足够的架构、配置、安全机制和验证资料，不能据此完成工程选型。读者可以用它跟踪新的锁步工作；如果当前就需要评估可用设计，还应同时查看公开行为说明更完整的 CVA6-Safe。
建议起步
分类：SoC 与子系统状态：编辑判断 · 实验阶段适合：工程师
核心速览
- 已确认范围：面向 CVA6 处理器核心的双核锁步模块/平台
- 文档状态：公开项目文档仍标为建设中
- 证据边界：详细架构、安全机制、配置选项和验证结果尚未公开
- 活跃度：2026 年仍有开发活动，但活跃本身不能证明技术成熟度
2星标
2分叉
分类
SoC 与子系统
标签
OpenHWRISC-VSoCLockstepSafetyDCLSCVA6
适合人群
工程师研究人员
贡献活跃度低活跃度
1
贡献者
3
待处理 Issues
0
近期提交（4 周）
0
开放中 PR
数据更新于 2026年10月12日
已核实的产业采用、贡献方与技术血缘、教学使用、演讲资料、技术文章及生态关联会依据具名来源逐步补充。
相关项目
CVA6
CVA6 是可配置的六级顺序执行 CORE-V 处理器家族，覆盖 32 位与 64 位嵌入式及应用级系统。现有 RTL 已包含 CV32A60X 等单发射配置和 CV32A65X 等双发射配置。指令集扩展、特权级和虚拟内存能力取决于所选配置：应用级配置可运行 Linux，而嵌入式 CV32A60X、CV32A65X 配置不包含 MMU 或 S/U 模式。仓库汇集处理器 RTL、验证环境、FPGA 集成与文档，适合核心选型、微架构研究，以及通过 CV-X-IF 探索自定义扩展。
CVA6-Safe
CVA6-Safe 是一套实验性的 CVA6 子系统，可工作在双核锁步模式，也可将两个核心拆分为独立运行。锁步模式加入比较式故障检测和缓存错误检测/纠正；split 模式则关闭这些保护，以普通双核非对称多处理方式运行。该项目适合研究容错 RISC-V 架构的工程师，但公开设计文档仍不完整，仓库也没有声明获得 ISO 26262 认证。